基于FPGA的片內(nèi)并行機網(wǎng)絡(luò)模型優(yōu)化策略分析
所屬分類：技術(shù)論文
上傳者：aet
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文檔介紹：針對基-2 FFT處理算法,采用分塊存儲思想,將存儲器、處理機數(shù)據(jù)交換網(wǎng)絡(luò)模型進行優(yōu)化。優(yōu)化后的網(wǎng)絡(luò)模型數(shù)據(jù)通路數(shù)僅為20,降低為原來的4%以下,且不隨FFT計算點數(shù)增多而增加。整個設(shè)計在Virtex系統(tǒng)芯片XCV800上實現(xiàn)。
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