基于AVS的變字長解碼器的設(shè)計及其FPGA驗證
所屬分類：技術(shù)論文
上傳者：aet
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文檔介紹：提出了一個完整的AVS變字長解碼器的硬件架構(gòu)，在設(shè)計中采用加入FIFO的方法構(gòu)成流水結(jié)構(gòu)，并盡量減少變字長解碼器中各子模塊的運行節(jié)拍，大大提高了系統(tǒng)的運行速度。本設(shè)計已經(jīng)通了FPGA驗證。該變字長解碼器不僅可以成為其他AVS解碼器的硬件加速器，同時由于視頻編解碼標(biāo)準(zhǔn)的相似性，稍加改動即可應(yīng)用在其他的視頻標(biāo)準(zhǔn)中。
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