《電子技術應用》
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如何更好地挑战电源0.1W待机功耗需求
摘要: 随着全球气候日益变暖,节能减排已排在各国政府工作重中之重,特别是和日常生活息息相关的电子行业,更是被置于风口浪尖,在欧美市场,低待机功耗已经和安规,EMI一起成为电子产品销往这个市场的通行证,并且不断地要求降低待机功耗值,这一举措,意义深远。“高效率,低待机功耗”已成为广大电子产品开发工作者在产品开发中必须考虑的重要因素之一,做为电子产品的心脏,电源电路部分在这项高效低损的革命中,一次一次地被赋予最为关健的使命,特别是在电子产品进入待机状态后,其它部分电路都进入关闭或者休眠状态,电源电路在这个时候本身工作时所产生的损耗,在整个系统的损耗中占据很大的份额,其地位举足轻重,所以从最初国际能源组织的对电源待机功耗无要求,到后来的要求少于1W,再到现在的0.3W,步步为营,事实证明,要求电源待机功耗小于0.1W的时代即将来临。为了实现电源低待机功耗的要求,半导体厂商和电源工程师们从未停止过努力,半导体厂商不断的改进工艺,电源工程师不断的优化电源系统,但是努力之后,总会进入山穷水尽的境地,图1是一个电源的标准线路图,当我们使尽浑身解数后,发现整个电路中元器件不能再省,电路不能再优化时,我们还有其它新的办法吗?
Abstract:
Key words :

     隨著全球氣候日益變暖,節(jié)能減排已排在各國政府工作重中之重,特別是和日常生活息息相關的電子行業(yè),更是被置于風口浪尖,在歐美市場,低待機功耗已經(jīng)和安規(guī),EMI一起成為電子產(chǎn)品銷往這個市場的通行證,并且不斷地要求降低待機功耗值,這一舉措,意義深遠。“高效率,低待機功耗”已成為廣大電子產(chǎn)品開發(fā)工作者在產(chǎn)品開發(fā)中必須考慮的重要因素之一,做為電子產(chǎn)品的心臟,電源電路部分在這項高效低損的革命中,一次一次地被賦予最為關健的使命,特別是在電子產(chǎn)品進入待機狀態(tài)后,其它部分電路都進入關閉或者休眠狀態(tài),電源電路在這個時候本身工作時所產(chǎn)生的損耗,在整個系統(tǒng)的損耗中占據(jù)很大的份額,其地位舉足輕重,所以從最初國際能源組織的對電源待機功耗無要求,到后來的要求少于1W,再到現(xiàn)在的0.3W,步步為營,事實證明,要求電源待機功耗小于0.1W的時代即將來臨。為了實現(xiàn)電源低待機功耗的要求,半導體廠商和電源工程師們從未停止過努力,半導體廠商不斷的改進工藝,電源工程師不斷的優(yōu)化電源系統(tǒng),但是努力之后,總會進入山窮水盡的境地,圖1是一個電源的標準線路圖,當我們使盡渾身解數(shù)后,發(fā)現(xiàn)整個電路中元器件不能再省,電路不能再優(yōu)化時,我們還有其它新的辦法嗎?

電源的標準線路圖

圖1 電源的標準線路圖

  如圖1虛線所圈部分,這是一個電源的EMI濾波電路,在這個電路中,請注意一下X電容C1上面并聯(lián)的兩個電阻,這兩個電阻是起什么作用呢?電容是可以存儲電能的產(chǎn)品,當我們電源接通交流電后,交流電會對C1充電,被充電后的電容存儲著電量,當我們把電源插頭從交流電源上拔出后,這個電量仍然存在于電容中,這個電容的兩端直接與電源插頭的兩個腳相連,換言之,如果這里人體不慎碰到插頭的兩個腳,就會被電容上的電量觸電,所以安規(guī)中強制規(guī)定,這個電容上的電量必須在電源插座被拔除后一定的時間泄放完,所以這兩個電阻在這里起放電作用,是萬萬不能省的,但是這兩個電阻直接與交流電源相連,也就是說,在電源進入待機狀態(tài)后時,這兩個電阻在消耗著能量,它上面的損耗有多大呢?圖2中列出了跟不同X 電容匹配的電阻所生的損耗,X電容越大,放電電阻越小,其損耗就越大,結果顯示,這個放電電阻上面有幾十mW到幾百mW的損耗,再加上其它元器件上的損耗,整機小于0.1W的目標淪為了天方夜談。

圖2

圖2

  如果說在這兩個電阻上串一個智能開關,如圖3 所示,切斷交流電源時開關吸合,從而把兩個電阻連起來,快速泄放走X電容的電荷,而接上交流電源時開關切斷,從而把兩個電阻斷開,讓這時兩個電阻上沒有電流流過,實現(xiàn)零損耗,不是一個兩全齊美的好方法嗎?

圖3

圖3

  電源半導體先驅,打造綠色環(huán)保IC的創(chuàng)導者和領導者,美國PI公司把這一個電源工程師的想法變成了一個產(chǎn)品,被命名為Cap Zero,圖3為其等效電路圖,圖4為其內部電路圖,圖5為其實物圖,從圖4中可以看出,它由檢測控制電路和開關電路組成,檢測控制電實時檢測著X電容兩端的交流電壓(即電源插座上的交流電壓),當X電容兩端電壓存在時,檢測控制電路會保持相應的信號讓開關電路保持關閉狀態(tài),反之,則開通。因為設計者不再擔心X電容放電電阻的損耗,所以設計者可以選用更大的X 電容,減小差模電感,這讓設計者在設計EMI 電路時有更多的組合方案和改進空間。

內部電路圖

圖4 內部電路圖

圖5

圖5

  目前這一產(chǎn)品為SO-8的封裝,電源設計者無須做任何調試,只需要在PCB板上LAYOUT上這個封裝,需要時裝上去,不需要時用Jump短路即可,簡單易操作,可靠實用。Cap Zero的出現(xiàn),在電源設計者挑戰(zhàn)電源0.1W待機功耗的征程中,無疑又留下了光輝的一筆。


 

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