截短Reed-Solomon碼譯碼器的FPGA實現(xiàn)
張 玲，張 立，何 偉
摘要： 提出了一種改進的BM算法，并在此基礎上提出了一種大量采用并行結構的截短RS碼譯碼器的實現(xiàn)方式。驗證表明，該算法能顯著提高基于FPGA的RS譯碼器的速度并簡化其電路結構。
Abstract：
Key words :
摘 要： 提出了一種改進的BM算法，并在此基礎上提出了一種大量采用并行結構的截短RS碼譯碼器的實現(xiàn)方式。驗證表明，該算法能顯著提高基于FPGA的RS譯碼器的速度并簡化其電路結構。
關鍵詞： RS譯碼器；關鍵方程；BM算法；FPGA；并行結構
此內容為AET網站原創(chuàng)，未經授權禁止轉載。